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Cadence低功耗解決方案助力凌訊科技獲得90nm芯片一次成功

凌訊選擇Cadence作為首選EDA供應商并利用Cadence低功耗解決方案進行高級DT V和無線設計
2008-10-29
作者:Cadence設計系統(tǒng)公司
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全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司納斯達克CDNS今天宣布數(shù)字廣播" title="數(shù)字廣播">數(shù)字廣播及無線寬帶通信" title="寬帶通信">寬帶通信傳輸領域的核心技術開發(fā)及相關應用產(chǎn)品提供商凌訊科技" title="凌訊科技">凌訊科技(Legend Silicon)利用Cadence低功耗" title="低功耗">低功耗解決方案已成功完成一款90納米芯片設計并獲得投片的一次成功。凌訊選擇Cadence為其65納米及45納米設計的首選EDA供應商, 還將采用整套Cadence Low-Power Solution這突出了Cadence在推動和增強低功耗設計創(chuàng)新方面的承諾。 ?

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使用Cadence的軟件凌訊科技成功完成了這一款有挑戰(zhàn)性的、數(shù)百萬門級90納米DTV設計目前已處于量產(chǎn)階段。因此,凌訊科技現(xiàn)得以向用戶提供更加領先業(yè)界的地面數(shù)字電視解調(diào)芯片產(chǎn)品及解決方案。?

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利用Cadence的設計、驗證和實現(xiàn)技術,凌訊科技可以大幅壓縮設計周期,并獲得芯片設計" title="芯片設計">芯片設計的一次成功。”凌訊科技總裁兼首席技術官楊林博士表示,“與Cadence進行緊密合,并確定其成為我們65納米和45納米設計的首選EDA廠商,將有利于保持并提高凌訊科技在數(shù)字廣播及無線寬帶通信傳輸領域的競爭優(yōu)勢,并在更短的時間期限內(nèi)為客戶提供更好的解決方案。” ?

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作為首選的EDA供應商,Cadence將向凌訊科技提供先進的EDA技術,用于其45納米/65納米低功耗層次化設計流程。凌訊科技還將采用基于通用功耗格式Common Power Format CPFCadence Low-Power Solution它包含Incisive Enterprise SimulatorEncounter Conformal Low PowerEncounter RTL Compiler全局綜合、SoC Encounter? RTL-to-GDSII系統(tǒng),以及VoltageStorm功耗分析。 ?

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“Cadence致力于幫助客戶實現(xiàn)創(chuàng)新和成功。”Cadence亞太區(qū)總裁兼全球副總裁居龍表示,“經(jīng)驗證明基于CPF的Cadence Low-Power Solution將幫助凌訊科技實現(xiàn)高級低功耗管理策略帶來的功耗降低優(yōu)勢,同時加快上市時間、提高生產(chǎn)力并減少設計方法學中的風險。” ?

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Cadence Low-Power Solution是業(yè)界第一款將利用通用功耗格式(Common Power Format)整合邏輯設計、驗證和實現(xiàn)技術的完整流程。 它已經(jīng)在眾多芯片設計和應用中得到驗證。 使用該流程,設計人員實現(xiàn)了兩倍的生產(chǎn)力提升和平均40%的功耗節(jié)省。

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關于Cadence ?

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Cadence公司成就全球電子設計技術創(chuàng)新,并在創(chuàng)建當今集成電路和電子產(chǎn)品中發(fā)揮核心作用。我們的客戶采用Cadence的軟件、硬件、設計方法和服務,來設計和驗證用于消費電子產(chǎn)品、網(wǎng)絡和通訊設備以及計算機系統(tǒng)中的尖端半導體器件、印刷電路板和電子系統(tǒng)。Cadence 2007年全球公司收入約16億美元,現(xiàn)擁有員工約5100名,公司總部位于美國加州圣荷塞市,公司在世界各地均設有銷售辦事處、設計中心和研究設施,以服務于全球電子產(chǎn)業(yè)。?

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