基于DSP Builder的插值濾波器的設(shè)計(jì)及FPGA實(shí)現(xiàn)
所屬分類：參考設(shè)計(jì)
上傳者：aet
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文檔介紹：在數(shù)字接收機(jī)中，通常需要對采樣的數(shù)據(jù)進(jìn)行一定倍數(shù)的插值。采用Altera公司的DSP Builder設(shè)計(jì)工具，在MATLAB/Simulink中建立相應(yīng)的算法模型并仿真。通過引入回路硬件模塊，將硬件平臺接入由Simulink構(gòu)建的仿真測試回路中進(jìn)行軟硬件協(xié)同仿真，最后可以直接生成FPGA的下載文件。該方法簡化了設(shè)計(jì)流程，降低了開發(fā)成本和周期，具有廣闊的應(yīng)用前景。
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