| LTE系統(tǒng)中小區(qū)搜索定時同步的FPGA設計 | |
| 所屬分類：技術論文 | |
| 上傳者：aet | |
| 文檔大小：499 K | |
| 標簽： 長期演進 小區(qū)搜索 主同步信號 | |
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| 文檔介紹：對比于傳統(tǒng)DSP串行模式，基于FPGA提出了一種并行高效的小區(qū)搜索定時同步設計方案。從空中接口接收數(shù)據(jù)到FPGA的片內(nèi)存儲模塊，采用多路高速乘法器進行序列互相關檢測和動態(tài)門限配置，實現(xiàn)了數(shù)據(jù)接收和處理的無縫銜接，大大縮短了主同步信號的檢測時間，降低了解碼復雜度，并以Virtex-6芯片為硬件平臺進行了仿真、綜合、板級驗證、聯(lián)機驗證等工作。實現(xiàn)結果表明，該設計方案的處理速度和數(shù)據(jù)精度滿足LTE系統(tǒng)測試要求，已應用于終端測試儀表的開發(fā)中。 | |
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