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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問題，設(shè)備可以在那里重新編程。

基于FPGA的音頻Sigma-Delta調(diào)制器設(shè)計(jì)與實(shí)現(xiàn)

隨著數(shù)字音源的普及，數(shù)模轉(zhuǎn)換器（Digital to Analog Converter， DAC）成為音頻設(shè)備中不可或缺的元件，其精度往往決定著整個(gè)系統(tǒng)的信號(hào)保真度。基于此，利用噪聲整形技術(shù)對(duì)用于高精度音頻DAC的Sigma-Delta調(diào)制器進(jìn)行設(shè)計(jì)和現(xiàn)場(chǎng)可編程門陣列（Field Programmable Gate Array， FPGA）實(shí)現(xiàn)。通過搭建測(cè)試系統(tǒng)，測(cè)試結(jié)果表明，所設(shè)計(jì)的Sigma-Delta調(diào)制器在輸入信號(hào)為1 411.2 kHz采樣頻率、1 kHz頻率、0 dBFS（Full Scale）幅度的正弦信號(hào)條件下，其輸出信噪比（Signal to Noise Ratio， SNR）可達(dá)107.4 dB；當(dāng)輸入信號(hào)頻率在音頻頻帶內(nèi)時(shí)（輸入信號(hào)幅度為0 dBFS），其輸出SNR穩(wěn)定保持在104 dB以上；并可用于WAV音樂播放器中。

發(fā)表于：6/19/2025

如何在LTspice中添加電壓控制開關(guān)

　　摘要　　本文詳細(xì)介紹了在LTspice®原理圖中添加電壓控制開關(guān)的步驟。文中列舉了幾個(gè)示例，著重說明了電壓控制開關(guān)在瞬態(tài)仿真中的使用。

發(fā)表于：6/15/2025

從發(fā)明到 AI 加速:慶祝 FPGA 創(chuàng)新 40 周年

今年是首款商用現(xiàn)場(chǎng)可編程門陣列( FPGA )誕生 40 周年,其帶來了可重編程硬件的概念。通過打造“與軟件一樣靈活的硬件”,FPGA 可重編程邏輯改變了半導(dǎo)體設(shè)計(jì)的面貌。這是開發(fā)人員第一次能在設(shè)計(jì)芯片時(shí),如果規(guī)格或需求在中途、甚至在制造完成后發(fā)生變化,他們可以重新定義芯片功能以執(zhí)行不同的任務(wù)。

發(fā)表于：6/4/2025

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問題，設(shè)備可以在那里重新編程。

發(fā)表于：6/4/2025

開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

發(fā)表于：5/23/2025

基于FPGA的多通道橇載數(shù)據(jù)采集存儲(chǔ)系統(tǒng)設(shè)計(jì)

針對(duì)火箭橇試驗(yàn)極端環(huán)境下數(shù)據(jù)測(cè)量難、精確度不高等問題，設(shè)計(jì)了一種基于FPGA的多通道、高精度數(shù)據(jù)采集存儲(chǔ)系統(tǒng)。該系統(tǒng)能夠?qū)鞲衅鬏敵龅哪M信號(hào)進(jìn)行調(diào)理，以FPGA作為主控芯片，控制兩片AD7606芯片對(duì)12個(gè)通道進(jìn)行同步采集，將采集的數(shù)據(jù)進(jìn)行實(shí)時(shí)處理并存儲(chǔ)至Flash芯片。PC端的上位機(jī)可以對(duì)存儲(chǔ)至Flash的數(shù)據(jù)進(jìn)行回讀，并將數(shù)據(jù)解析繪圖。并通過灌封工藝使系統(tǒng)具有抗高沖擊、高過載的特性。經(jīng)試驗(yàn)表明，該系統(tǒng)實(shí)現(xiàn)了12路通道的實(shí)時(shí)同步采集，測(cè)量結(jié)果非線性誤差不大于1%，能夠滿足火箭橇試驗(yàn)環(huán)境下數(shù)據(jù)采集與存儲(chǔ)的可靠性要求。

發(fā)表于：5/15/2025

基于芯粒的Flash FPGA驅(qū)動(dòng)測(cè)試技術(shù)

針對(duì)基于芯粒的Flash FPGA驅(qū)動(dòng)覆蓋率測(cè)試，利用Flash FPGA的系統(tǒng)控制寄存器與邊界掃描寄存器模塊，配置FPGA不同的驅(qū)動(dòng)模式，并通過傳統(tǒng)的單芯片F(xiàn)lash單元配置進(jìn)行對(duì)比驗(yàn)證。實(shí)驗(yàn)結(jié)果表明，基于芯粒的Flash FPGA控制寄存器配置的驅(qū)動(dòng)性能與傳統(tǒng)的單芯片F(xiàn)lash單元配置一致，測(cè)試時(shí)間縮短到1/3。

發(fā)表于：5/14/2025

基于高云Arora-V 60K FPGA實(shí)現(xiàn)的MIPI CPHY轉(zhuǎn)MIPI DPHY透?jìng)髂K

近期，高云代理商聯(lián)詮國(guó)際聯(lián)合合作伙伴DepEye（深目微）共同推出 MIPI CPHY轉(zhuǎn)DPHY (C2D)透?jìng)髂K：DEGC2DV60，功能基于高云GW5AT-LV60 FPGA實(shí)現(xiàn)，該產(chǎn)品適用于需要從 MIPI CPHY RX 橋接到 MIPI DPHY TX 的應(yīng)用場(chǎng)景。

發(fā)表于：4/22/2025

英特爾正式宣布出售Altera 51%股份

4 月 14 日消息，英特爾北京時(shí)間 20:30 正式宣布同私募股權(quán)企業(yè) Silver Lake 銀湖資本達(dá)成 FPGA 子公司 Altera 股份出售協(xié)議。Silver Lake 將以 87.5 億美元的估值買下 Altera 51% 的股份，英特爾繼續(xù)持有剩余 49% 股份。

發(fā)表于：4/14/2025

Microchip推出多功能MPLAB® PICkit? Basic調(diào)試器

　　為使更多工程師能夠享受更強(qiáng)大的編程與調(diào)試功能，Microchip Technology Inc.（微芯科技公司）今日發(fā)布MPLAB® PICkit? Basic在線調(diào)試器，為各層級(jí)的工程師提供高性價(jià)比解決方案。相較于其他復(fù)雜昂貴的調(diào)試器，這款經(jīng)濟(jì)型工具提供高速USB 2.0連接、CMSIS-DAP支持、兼容多種集成開發(fā)環(huán)境（IDE）和單片機(jī)。該調(diào)試器的多功能性使開發(fā)人員能在各類項(xiàng)目與平臺(tái)（包括VS Code®生態(tài)系統(tǒng)）中使用，簡(jiǎn)化工作流程并減少多工具需求。

發(fā)表于：3/10/2025

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