2010最新獲獎文章-----基于FPGA的單精度浮點數(shù)乘法器設(shè)計
所屬分類：參考設(shè)計
上傳者：chenyy
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標(biāo)簽： FPGA
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文檔介紹：本文設(shè)計了一個基于FPGA的單精度浮點數(shù)乘法器。乘法器為五級流水線結(jié)構(gòu)。設(shè)計中采用了改進的帶偏移量的冗余Booth3算法和跳躍式Wallace樹型結(jié)構(gòu)，減少了部分積的數(shù)目，縮短了部分積累加的耗時；提出了對尾數(shù)定點乘法運算中Wallace樹產(chǎn)生的2個偽和采用部分相加的處理方式，有效地提高了的運算速度；并且加入了對特殊值的處理模塊，完善了乘法器的功能。單精度浮點數(shù)乘法器在Altera DE2開發(fā)板上進行了驗證，其在Cyclone II EP2C35F672C6器件上的最高工作頻率達到212.13 MHz。
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