| 混合壓縮比結(jié)構(gòu)16×16陣列乘法器設(shè)計(jì) | |
| 所屬分類(lèi)：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：331 K | |
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| 文檔介紹：在比較各種樹(shù)型結(jié)構(gòu)的基礎(chǔ)上，提出了一種適合于16×16陣列乘法器的混合壓縮比結(jié)構(gòu)。并且采用改進(jìn)布斯編碼算法和符號(hào)補(bǔ)償技術(shù)，用VHDL語(yǔ)言設(shè)計(jì)出了一個(gè)16×16有/無(wú)符號(hào)數(shù)乘法器。仿真結(jié)果表明，該乘法器綜合性能優(yōu)于采用IA和Wallace結(jié)構(gòu)的乘法器，可用作數(shù)字系統(tǒng)中的乘法單元模塊。所提出的混合壓縮比結(jié)構(gòu)還可以作為10-2壓縮器應(yīng)用于更高位數(shù)乘法器的設(shè)計(jì)之中，具有較高的實(shí)用價(jià)值。 | |
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