基于FPGA的μC/OS-II任務(wù)管理硬件設(shè)計(jì)
所屬分類：技術(shù)論文
上傳者：aet
文檔大小：352 K
標(biāo)簽： FPGA
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文檔介紹：針對實(shí)時(shí)操作系統(tǒng)的開銷導(dǎo)致應(yīng)用程序可執(zhí)行性降低的問題，提出了基于FPGA的硬件實(shí)時(shí)操作系統(tǒng)設(shè)計(jì)方案，并實(shí)現(xiàn)了μC/OS-II任務(wù)管理模塊的硬件化。通過設(shè)計(jì)基于片內(nèi)寄存器的TCB及基于組合電路的任務(wù)調(diào)度器，充分發(fā)揮了多任務(wù)潛在的并行性。整個(gè)設(shè)計(jì)采用VHDL硬件描述語言，通過ISE 8.2軟件進(jìn)行時(shí)序仿真驗(yàn)證，并使用Xilinx公司的Virtex-II Pro FPGA板實(shí)現(xiàn)。
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