12位電容電阻混合式SAR ADC IP核的設(shè)計(jì)
所屬分類：技術(shù)論文
上傳者：aet
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文檔介紹：在深入分析逐次逼近型的模數(shù)轉(zhuǎn)換器SAR ADC的基礎(chǔ)上,對(duì)內(nèi)置DAC和比較器的設(shè)計(jì)進(jìn)行了優(yōu)化,實(shí)現(xiàn)了一款適用于工業(yè)控制器的SAR ADC IP核的設(shè)計(jì).芯核采用0.18um CMOS Mix_singal IP6M工藝,分別采用3.3V的模擬電源電壓和1.8V的數(shù)字電源電壓供電,仿真結(jié)果表明,該SAR ADC IP核實(shí)現(xiàn)了12bit的精度.IP核的面積為800um*420um,FF case下功耗為1.2mW,微分非線性誤差DNL<0.5 LSB.
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