| 基于FPGA+DDS的信號源設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：309 K | |
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| 文檔介紹：采用DDS+FPGA+DAC數(shù)字信號激勵(lì)器硬件電路和數(shù)字波形合成軟件算法設(shè)計(jì)實(shí)現(xiàn)了寬帶信號源所需要的各類信號,覆蓋30MHz~1GHz頻段,功率達(dá)到20W.在完成了具體的設(shè)計(jì)和實(shí)驗(yàn)后實(shí)現(xiàn)了樣機(jī)的制作,通過現(xiàn)場測試驗(yàn)證了其完全滿足應(yīng)用需求. | |
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