| 基于FPGA的高效靈活的數(shù)字正交下變頻器設(shè)計 | |
| 所屬分類：解決方案 | |
| 上傳者：coco | |
| 文檔大小：260 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：數(shù)字正交下變頻器（DDC）是數(shù)字接收機(jī)系統(tǒng)中的核心部件，其作用是將ADC數(shù)字化后輸出的高速的中頻信號進(jìn)行下變頻、抽取降速、低通濾波，變?yōu)檫m合處理的基帶信號。本文給出了DDC各模塊在FPGA中高效實現(xiàn)的方法，利用嵌入式邏輯分析儀，對系統(tǒng)加載板卡后的實時運(yùn)行結(jié)果進(jìn)行了測試分析。 | |
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