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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場(chǎng)可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺(tái)式編程器中立即運(yùn)行，而無(wú)需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯(cuò)誤或問(wèn)題，設(shè)備可以在那里重新編程。

愛捷仕MES軟件推動(dòng)EPE實(shí)現(xiàn)顯著質(zhì)量改進(jìn)

2016年5月18日，美國(guó)新罕布什爾州，曼切斯特：成立于1965年的EPE公司是業(yè)內(nèi)著名的高可靠性電子制造專家，EPE于2000年首次選擇愛捷仕軟件作為其制造軟件系統(tǒng)（MES）供應(yīng)商。

發(fā)表于：5/27/2016

基于FPGA與SD卡的圖像產(chǎn)生器設(shè)計(jì)

超高解析度圖像產(chǎn)生器用于檢測(cè)超高解析度液晶顯示器的性能和品質(zhì)。為了實(shí)現(xiàn)其便攜性和通用性，提出了一種基于FPGA與SD卡的設(shè)計(jì)方案。在檢測(cè)顯示器的質(zhì)量時(shí)需要切換各種圖像輸出，為了縮短圖像輸出的時(shí)間，采用FPGA實(shí)現(xiàn)了SD卡的SD模式。實(shí)際應(yīng)用表明，新型圖像產(chǎn)生器使用方便、數(shù)據(jù)傳輸快速可靠。

發(fā)表于：5/26/2016

基于FPGA的汽車ECU設(shè)計(jì)充分符合AUTOSAR和ISO 26262標(biāo)準(zhǔn)

當(dāng)今的汽車制造商正在把越來(lái)越多的高級(jí)功能添加到汽車電子控制單元（ECU）中，以改善駕駛體驗(yàn)，增強(qiáng)安全性，當(dāng)然還期望超過(guò)同類競(jìng)爭(zhēng)產(chǎn)品的銷量。在這種情況下，汽車開放系統(tǒng)架構(gòu) （AUTOSAR）計(jì)劃和功能安全國(guó)際標(biāo)準(zhǔn) ISO26262 正在快速成為汽車 ECU 設(shè)計(jì)的技術(shù)和架構(gòu)基礎(chǔ)。

發(fā)表于：5/26/2016

基于CBGA的多通道DDS封裝隔離度設(shè)計(jì)

介紹了一種基于陶瓷球柵陣列（CBGA）技術(shù)的多通道直接數(shù)字合成器(DDS)封裝結(jié)構(gòu)設(shè)計(jì)，提出了一種改進(jìn)隔離度的CBGA基板實(shí)現(xiàn)形式，并利用Ansoft HFSS軟件進(jìn)行了基板隔離度的優(yōu)化仿真，最后對(duì)所提出的設(shè)計(jì)進(jìn)行了實(shí)物測(cè)試。測(cè)試結(jié)果與仿真結(jié)果基本一致，表明所提出的封裝優(yōu)化設(shè)計(jì)成功地提高了多通道DDS的隔離度，為高隔離度的多通道DDS產(chǎn)品工程設(shè)計(jì)提供了參考。

發(fā)表于：5/26/2016

Linux多線程編程技術(shù)在擲骰子游戲模擬程序中的應(yīng)用

為了模擬概率事件，針對(duì)擲骰子游戲規(guī)則，應(yīng)用Linux系統(tǒng)下C語(yǔ)言多線程機(jī)制以及多個(gè)二值信號(hào)量以實(shí)現(xiàn)多個(gè)線程間循環(huán)同步。通過(guò)偽隨機(jī)數(shù)模擬擲骰子的點(diǎn)數(shù)，設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)基于多線程方式模擬4人擲骰子游戲程序,并對(duì)1 000次游戲中每個(gè)游戲者獲勝的次數(shù)進(jìn)行統(tǒng)計(jì)。可以看出，在多次游戲中，每個(gè)游戲者獲勝的概率符合概率分布規(guī)律。程序運(yùn)行結(jié)果表明，利用信號(hào)量可有效實(shí)現(xiàn)多個(gè)線程間的同步與互斥，并簡(jiǎn)化了程序結(jié)構(gòu)。

發(fā)表于：5/25/2016

FPGA開發(fā)板專題

FPGA技術(shù)當(dāng)今已成為每一為電子工程師的必修課，在各個(gè)領(lǐng)域中都有廣泛的應(yīng)用．使得ＦＰＧＡ開發(fā)板的需求也大量的增加．大家可能出于不同的應(yīng)用目的都需要購(gòu)買FPGA 開發(fā)板。然而大多數(shù)人對(duì)FPGA，不時(shí)很了解不能選擇好的產(chǎn)品，以至于影響自己的使用。

發(fā)表于：5/25/2016

基于RAG-n算法的低成本FIR濾波器實(shí)現(xiàn)

基于FIR數(shù)字濾波器多常數(shù)乘法的圖表示法，利用MATLAB對(duì)RAG-n算法進(jìn)行了實(shí)現(xiàn)。通過(guò)仿真該算法在大多數(shù)情況下都可以高效地解決加法器優(yōu)化問(wèn)題，有效降低了FIR濾波器常系數(shù)乘法的復(fù)雜度。在FPGA上用Verilog HDL語(yǔ)言對(duì)優(yōu)化實(shí)例進(jìn)行了實(shí)現(xiàn)，其綜合結(jié)果表明，該方法可以有效減少邏輯單元的消耗，適用于低成本數(shù)字系統(tǒng)設(shè)計(jì)。

發(fā)表于：5/25/2016

基于3D-Mesh互連網(wǎng)絡(luò)的粗粒度邏輯陣列研究

提出了一種3D-Mesh拓?fù)浠ミB網(wǎng)絡(luò)結(jié)構(gòu)，其支持動(dòng)態(tài)可重構(gòu)配置，數(shù)據(jù)路徑位寬為32 bit。基于該3D-Mesh拓?fù)浠ミB網(wǎng)絡(luò)結(jié)構(gòu)，設(shè)計(jì)了一種擁有48個(gè)RPE（Reconfigurable Process Element）和16個(gè)RSE（Reconfigurable Storage Element）的異構(gòu)粗粒度邏輯陣列（Isomerism Coarse-Grained Reconfigurable Array，ICGRA）。基于COMS 55 nm工藝庫(kù)進(jìn)行后端設(shè)計(jì)，ICGRA總面積為28.52 mm2。同時(shí)在300 MHz系統(tǒng)時(shí)鐘、1.08 V Vcc電壓、室溫條件下系統(tǒng)總功耗為2.88 W。其中3D-Mesh拓?fù)浠ミB網(wǎng)絡(luò)面積占系統(tǒng)總面積的3.8%，功耗占系統(tǒng)總功耗的7%。與相關(guān)設(shè)計(jì)對(duì)比，該結(jié)構(gòu)動(dòng)態(tài)重構(gòu)速率提高2倍~60倍。且采用該3D-Mesh拓?fù)渚W(wǎng)絡(luò)之后，運(yùn)算單元利用率也大幅度提高。

發(fā)表于：5/25/2016

MATLAB 增強(qiáng)對(duì)數(shù)字輔助 RF MIMO 系統(tǒng)的設(shè)計(jì)支持

MathWorks今日宣布，增強(qiáng)了用于支持?jǐn)?shù)字輔助 RF MIMO 系統(tǒng)設(shè)計(jì)的功能。2016a 版本中對(duì) RF 工具箱、SimRF 和天線工具箱的更新，將幫助工程師提升 RF仿真能力，輔助執(zhí)行初步RF 鏈路預(yù)算分析（通過(guò)高級(jí)模型可擴(kuò)展該功能），有助于將 RF 設(shè)計(jì)結(jié)果集成到系統(tǒng)級(jí)仿真。

發(fā)表于：5/24/2016

我和FPGA的第一次接觸！有獎(jiǎng)?wù)魑拇筚悾?

人生總是有許多的第一次，第一次上學(xué)、第一次約會(huì)、第一次唱歌、第一次跳舞……每個(gè)“第一次”都是令人難忘的記憶。作為一個(gè)小小電工，也有很多個(gè)第一次，你還記得第一次和FPGA接觸的時(shí)候是什么感受嗎？記錄下來(lái)吧，成為青春的回憶！

發(fā)表于：5/24/2016

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