| 一種高能效基4-Booth編碼并行乘法器設計 | |
| 所屬分類：技術論文 | |
| 上傳者：zhoubin333 | |
| 文檔大?。?span>3760 K | |
| 標簽： 卷積神經網絡 乘法器 基4-Booth編碼 | |
| 所需積分：0分積分不夠怎么辦？ | |
| 文檔介紹：常用的卷積神經網絡中存在數十億次乘法運算，神經網絡中乘法的大量能耗成為硬件實現神經網絡的能效瓶頸之一。為了降低乘法器的能耗，提出了一種高能效基4-Booth編碼并行乘法器。通過改進部分積生成模塊，消除了傳統方法中的補償位，使得乘法器延時減小且能耗降低。后仿真結果顯示，所提出的乘法器比現有乘法器面積減小了5.2%，延時減小了6.3%，能耗降低了10.8%。 | |
| 現在下載 | |
| VIP會員，AET專家下載不扣分；重復下載不扣分，本人上傳資源不扣分。 | |
Copyright ? 2005-2024 華北計算機系統工程研究所版權所有 京ICP備10017138號-2