一種高速跳頻接收機的改進設計方案
所屬分類：技術論文
上傳者：aet
文檔大小：479 K
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文檔介紹：提出了一種新的利用接收機前端雙多鎖相環(PLL)和基帶直接數字頻率合成(DDS)共同實現高速跳頻的設計方案,根據系統的特點確定動態范圍,發射功率,接收靈敏度等關鍵指標,進行了高速跳頻制導接收機的總體方案,射頻前端和基帶基本算法框架設計,實現了76000跳/s的跳頻速率,減小了接收機的體積,同時降低了功耗.理論分析和測試結果表明,接收機達到了較高的性能.
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