摘 要：介紹了一種高斯" title="高斯">高斯—拉普拉斯(LOG)算子在FPGA中的實(shí)現(xiàn)方案" title="實(shí)現(xiàn)方案">實(shí)現(xiàn)方案，并通過對一幅bmp圖像的處理，論證了在FPGA中實(shí)現(xiàn)的LOG算子的圖像增強(qiáng)" title="圖像增強(qiáng)">圖像增強(qiáng)效果。
關(guān)鍵詞：高斯—拉普拉斯（LOG）? FPGA? Verilog
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