基于UVM和C語(yǔ)言驗(yàn)證JTAG調(diào)試協(xié)議的研究與實(shí)現(xiàn)
所屬分類：技術(shù)論文
上傳者：zhoubin333
文檔大小：3914 K
標(biāo)簽： UVM FPGA原型驗(yàn)證 C語(yǔ)言
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文檔介紹：芯片驗(yàn)證中，JTAG協(xié)議功能的好壞決定了芯片流片回來(lái)后是否具有可調(diào)試狀態(tài)。多數(shù)情況下是編寫一段既冗長(zhǎng)且不易維護(hù)的TestBench代碼進(jìn)行驗(yàn)證；有些情況依賴FPGA原型驗(yàn)證手段去驗(yàn)證JTAG協(xié)議，但在該情況下，一些模塊需進(jìn)行FPGA資源替換，無(wú)法保證與RTL級(jí)網(wǎng)表一致，可能導(dǎo)致流片后回來(lái)的芯片JTAG調(diào)試不通。針對(duì)這些情況，結(jié)合UVM方法學(xué)的通用性和C語(yǔ)言的便利性，提出一種基于UVM和C語(yǔ)言聯(lián)合驗(yàn)證JTAG調(diào)試協(xié)議的實(shí)現(xiàn)方法。UVM搭建驗(yàn)證JTAG協(xié)議的框架，C語(yǔ)言側(cè)編寫測(cè)試用例，用例通過(guò)調(diào)用UVM側(cè)實(shí)現(xiàn)的芯片JTAG接口驅(qū)動(dòng)時(shí)序的方法來(lái)到達(dá)實(shí)現(xiàn)C語(yǔ)言驗(yàn)證芯片JTAG協(xié)議的結(jié)果。
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