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所屬分類:
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上傳者:
neelam
文檔大小:
193 K
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文檔介紹:
在利用FPGA實現數字信號處理方面,分布式算法發揮著關鍵作用,與傳統的乘加結構相比,具有并行處理的高效性特點。本文研究了一種16階FIR濾波器的FPGA設計方法,采用Verilog HDI語言描述設計文件,在Xilinx ISE 7.1i及ModelSimSE 6.1b平臺上進行了實驗仿真及時序分析,并探討了實際工程中硬件資源利用率及運算速度等問題。
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