| 卷積編碼及Viterbi譯碼的低時延FPGA設計實現 | |
| 所屬分類：技術論文 | |
| 上傳者：aetmagazine | |
| 文檔大?。?span>564 K | |
| 標簽： 毫米波通信 卷積碼 Viterbi譯碼 | |
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| 文檔介紹：針對毫米波通信的高速率和低時延設計要求，設計實現1/2碼率(2，1，7)卷積碼的低時延譯碼。采用高度并行優化實現框架、低延時的最小值選擇方式，獲得Viterbi硬判決譯碼算法的輸出。利用基于Xilinx公司的Artix7-xc7a200t芯片綜合后，譯碼器的數據輸出延時約89個時鐘周期，最高工作頻率可達203.92 MHz。結果表明，該譯碼器可支持吉比特級的數據傳輸速率，實現了低延時、高速率的編譯碼器。 | |
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